特長
- Maximum ratings Supply voltage Vcc: 24 V Junction temperature Tj: –40 to +150°C
- Electrical characteristics VREF output voltage VREF: 5.0 V ± 1.5% UVLO operation start voltage Vuvlh: 10.5 V ± 0.7 V UVLO operation shutdown voltage Vuvll: 9.3 V ± 0.5 V UVLO hysteresis voltage Hysuvl: 1.2 V ± 0.5 V
- Functions Boost converter control with critical conduction mode Interleaving control with slave drop (SD) function at light load Off time control (OTC) function: Switching loss is decreased at light load. Brownout function Double OVP: Two line sense for over voltage protection Dynamic under voltage protection (DUVP): Sense for under voltage protection AC Hi voltage detection (ACDET) Feedback loop open detection ZCD signal open detection Master and Slave independenced over current protection 140 μs restart timer Package lineup: Pb-free SOP-20
説明
The R2A20132SP controls two boost converters to provide a active power factor correction. The R2A20132SP is based on R2A20112 and additional functions are Slave drop function at light load, Off time control, Brownout, Double OVP, Dynamic under voltage protection, and ZCD signal open detection. Also the reference voltage tolerance is improved. The R2A20132SP adopts critical conduction mode for power factor correction and realizes high efficiency and a low switching noise by zero current switching. Interleaving function improve ripple current on input or output capacitor by 180 degrees phase shift. The feedback loop open detection, over current protection are built in the R2A20132SP, and can constitute a power supply system of high reliability with few external parts.
| Part Number | Status | Samples | Stock | RoHS | Package | Lead Count (#) | Carrier Type | Moisture Sensitivity Level (MSL) | Pb (Lead) Free |
|---|---|---|---|---|---|---|---|---|---|
| R2A20132SP | Obsolete | N/A | Out of Stock | RoHS:EN RoHS:JA | SOP | 20# | Tape & Reel | No | |
| R2A20132SP#U0 | Obsolete | N/A | Out of Stock | RoHS:EN RoHS:JA | SOP | 20# | Tape & Reel | Yes | |
| R2A20132SP#W0 | Obsolete | Available | In Stock | Contact | SOP | 20# | Tape & Reel | 1 | Yes |
- ホワイトペーパー英語PDF 389 KB 2025年5月01日The USB-C Power Delivery 3.1 Extended Power Range (EPR) standard enables charging up to 240W, supporting demanding applications such as high-performance laptops, power tools, and small appliances. This paper presents a complete wall-to-battery solution architecture based on USB-C PD 3.1 EPR, detailing the AC-DC adapter, USB-C PD charger, and battery management system. It demonstrates how the technology supports faster charging and greater device compatibility through a universal connector.
- アプリケーションノート英語PDF 799 KB R16AN0074EU0100 Rev.1.00 2025年3月06日AI生成コンテンツ: USB-C Power Delivery 3.1 Extended Power Range (EPR) enables up to 240W power delivery with voltages up to 48V and currents up to 5A, supporting fast and efficient charging for high-power devices such as laptops, portable power stations, and large displays. The system integrates a GaN-based high-efficiency AC/DC adapter, a bi-directional 48V charger, and a Battery Management System (BMS) with fuel-gauge firmware. Key design challenges include high-efficiency power conversion, voltage/current flexibility, bidirectional power flow, safety, and modular scalability. The solution provides reference designs, BOM, schematics, Gerber files, and firmware to accelerate product development and ensure compliance with regulatory standards.
- テクニカルアップデート日本語
- アプリケーションノート日本語PDF 226 KB R03AN0003JJ0201 Rev.2.01 2014年6月04日AI生成コンテンツ: 本資料は、電源ICのフィードバック制御、過電圧保護(OVP)、ランプ制御、ゲートドライブ、およびブラウンアウト/ソフトスタート機能について説明しています。フィードバック信号の電圧閾値、OVPの作動ポイント、ランプ信号のタイミングパラメータを解説しています。ゲートドライブはピーク電流とMOSFETのスイッチング特性を扱い、ブラウンアウトとソフトスタート回路は電圧レベルを監視してMOSFETの動作とシステム起動を制御します。
- アプリケーションノート英語PDF 1.3 MB R19AN0015ED0102 Rev.1.02 2013年7月01日AI生成コンテンツ: The document provides layout recommendations and design rules for a dual port Ethernet PHY device supporting 10Base-T, 100Base-TX, and 100Base-FX. It covers strap pin configuration options for initial start-up settings, detailing the use of pull-up and pull-down resistors, including recommended resistor values and schematic examples. The strap pins function only during power-up or reset, with internal and external resistor configurations advised for noise immunity. Additional chapters address media interfaces, power supply layout, clock input, LED control, and unused pins.
- アプリケーションノート英語PDF 1.21 MB R19AN0014ED0102 Rev.1.02 2013年7月01日AI生成コンテンツ: The document provides layout recommendations and design rules for Dual PHY and Single Channel PHY ASSP devices. It covers strap pin configuration options for initial start-up settings, including pull-up and pull-down resistor values and configurations to ensure stable operation in noisy environments. The layout guidelines include power supply design, differential pair routing, media-dependent interfaces, MAC interfaces, and clock input circuits. Examples and tables illustrate resistor values and schematic configurations for strap pins.
- アプリケーションノート英語PDF 224 KB R03AN0009EJ0100 Rev.1.00 2012年2月22日AI生成コンテンツ: The document explains the internal functions of the R2A20112A IC, focusing on its UVLO block which prevents operation under low voltage, and the 5 V reference voltage used internally. It details the Error Amplifier that stabilizes PFC output voltage, the Zero Current Detection circuit essential for CRM operation, and the RAMP generator that controls PWM ON time using external components. The drive stage outputs pulses to power MOSFETs with specific peak current capabilities and includes driver circuit examples for different MOSFET gate charges.
- アプリケーションノート日本語AI生成コンテンツ: 本資料は、電源制御ICの電気特性や動作パラメータについて説明している。基準電圧、スイッチング周波数、電流検出などの内部機能や、誤差増幅器、ランプジェネレーター、過電流保護の役割を解説する。MOSFETのオン・オフタイミングや入力電圧、出力電圧、電流検出信号の関係も示されている。回路図により動作とタイミングが視覚的に示されている。
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- アプリケーションノート英語PDF 1.3 MB R19AN0015ED0102 Rev.1.02 2013年7月01日AI生成コンテンツ: The document provides layout recommendations and design rules for a dual port Ethernet PHY device supporting 10Base-T, 100Base-TX, and 100Base-FX. It covers strap pin configuration options for initial start-up settings, detailing the use of pull-up and pull-down resistors, including recommended resistor values and schematic examples. The strap pins function only during power-up or reset, with internal and external resistor configurations advised for noise immunity. Additional chapters address media interfaces, power supply layout, clock input, LED control, and unused pins.
- アプリケーションノート英語PDF 1.21 MB R19AN0014ED0102 Rev.1.02 2013年7月01日AI生成コンテンツ: The document provides layout recommendations and design rules for Dual PHY and Single Channel PHY ASSP devices. It covers strap pin configuration options for initial start-up settings, including pull-up and pull-down resistor values and configurations to ensure stable operation in noisy environments. The layout guidelines include power supply design, differential pair routing, media-dependent interfaces, MAC interfaces, and clock input circuits. Examples and tables illustrate resistor values and schematic configurations for strap pins.もっと見る (10)
アプリケーションノート、ホワイトペーパー (10)
製品通知(PCN、EOLなど) (3)
- テクニカルアップデート日本語
- テクニカルアップデート日本語PDF 110 KB TN-SPx-014A 2003年6月23日
- テクニカルアップデート日本語PDF 96 KB TN-SPx-013A 2003年5月06日
エラッタ、テクニカルアップデート (4)
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