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ルネサス エレクトロニクス株式会社 (Renesas Electronics Corporation)
JESD204B/C クロックジッタ減衰器

パッケージ情報

CADモデル:View CAD Model
Pkg. Type:VFQFPN
Pkg. Code:NLG88
Lead Count (#):88
Pkg. Dimensions (mm):10.0 x 10.0 x 0.9
Pitch (mm):0.4

環境及び輸出分類情報

Moisture Sensitivity Level (MSL)3
Pb (Lead) FreeYes
ECCN (US)EAR99
HTS (US)8542.39.0090

製品スペック

Lead Count (#)88
Carrier TypeReel
Moisture Sensitivity Level (MSL)3
Qty. per Reel (#)2500
Qty. per Carrier (#)0
Pb (Lead) FreeYes
Pb Free Categorye3 Sn
Temp. Range (°C)-40 to 85°C
Country of AssemblyTAIWAN
Country of Wafer FabricationSINGAPORE, USA
Accepts Spread Spec InputNo
Additive Phase Jitter Typ RMS (fs)63.1
Additive Phase Jitter Typ RMS (ps)0.063
Adjustable PhaseYes
Advanced FeaturesHoldover, Phase Delay, Input Switching, JESD204B, Programmable Clock
Channels (#)1
Core Voltage (V)3.3V
DPLL Channels (#)0
Feedback Divider Resolution (bits)12
Fractional Output Dividers (#)0
Frequency Plan2949.12 / Output_Divider
Input Freq (MHz)1.92 - 2000
Input RedundancyInput Monitor, Auto-switch, Manual switch, Revertive and non-revertive switch, Holdover
Input Ref. Divider Resolution (bits)12
Input TypeLVDS, LVPECL
Inputs (#)2
JESD204B/C CompliantYes
Length (mm)10
Loop Bandwidth Range (Hz)20 - 100
MOQ2500
Noise Floor (dBc/Hz)-160
Output Banks (#)5
Output Divider Resolution (bits)8
Output Freq Range (MHz)18.432 - 2949.12
Output TypeLVDS, LVPECL
Output Voltage (V)3.3V
Outputs (#)15
PLLYes
Package Area (mm²)64
Phase Jitter Typ RMS (fs)63.1
Phase Jitter Typ RMS (ps)0.063
Phase Noise Supports GSMYes
Pitch (mm)0.4
Pkg. Dimensions (mm)10.0 x 10.0 x 0.9
Pkg. TypeVFQFPN
Ports (#)1
Product CategoryJESD204B/C, Jitter Attenuators
Prog. ClockYes
Reel Size (in)13
Requires Terms and ConditionsDoes not require acceptance of Terms and Conditions
Supply Voltage (V)3.3 - 3.3
Synthesis ModeInteger
Tape & ReelYes
Thickness (mm)0.9
Width (mm)10
Xtal Freq (KHz)30720 - 250000

説明

8V19N492は、FemtoClock® NGジッタ減衰器とクロックシンセサイザを統合し、無線基地局無線装置基板のコンディショニングと周波数/位相管理のための高性能クロックソリューションとして設計されています。 このデバイスは、GSM、WCDMA、LTE、LTE-Aの無線基板実装に必要な優れた位相ノイズ性能を実現するために最適化されています。 デバイスは、JESD204B サブクラス0および1のクロックをサポートしています。

二段構成のPLLアーキテクチャはジッタ減衰と周波数多重の両方をサポートしています。 初段のPLLはジッタ減衰器であり、外付けのVCXOを使用し、位相ノイズ特性を最適化しています。 2段目のPLLはVCXO-PLL出力信号をロックして目標周波数を合成します。

このデバイスは、選択したVCOと低周波同期信号(SYSREF)から高周波クロックを生成することをサポートしています。 SYSREF信号は、内部でクロック信号に同期しています。 システム基準信号とクロック信号の間の位相遅延を調整し制御するための、そして個々の出力信号を調整/遅延させるための遅延機能が存在しています。 冗長化された2つの入力が動作を監視します。 クロック入力の不具合に対応するため、4種類のクロック切り替えモードを搭載しています。 オートロック、個別にプログラム可能な出力周波数分割器、位相調整機能などを追加し、柔軟性を高めています。 8V19N492は、ワイヤレスインフラ、レーダ/イメージング、計測/医療アプリケーションのコンバータ回路の駆動に最適です。 このデバイスは、IDT社の高性能クロックファミリの一員です。

評価ボード、評価材料については、営業担当までお問い合わせください。