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概要

説明

The 72V245 is a 4K x 18 first-in, first-out (FIFO) memory with clocked read and write controls. It is a 3.3V version of the 72245 FIFO and is applicable for a wide variety of data buffering needs, such as optical disk controllers, Local Area Networks (LANs), and interprocessor communication. It has 18-bit input and output ports. The Read Clock (RCLK) can be tied to the Write Clock for single-clock operation, or the two clocks can run asynchronously of one another for dual-clock operation.

特長

  • 10ns read/write cycle time
  • 5V input tolerant
  • Renesas Standard or First Word Fall Through timing
  • Single or double register-buffered Empty and Full flags
  • Easily expandable in depth and width
  • Asynchronous or coincident Read and Write Clocks
  • Asynchronous or synchronous programmable Almost-Empty and Almost-Full flags with default settings
  • Half-Full flag capability
  • Output enable puts output data bus in high-impedance state
  • Available in 64-pin TQFP and STQFP packages
  • Industrial temperature range (–40°C to +85°C) is available

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モデル

ECADモデル

SamacSysの回路図シンボル、PCBフットプリント、および3D CADモデルは、製品オプションテーブルのCADモデルリンクをクリックすることで参照できます。シンボルまたはモデルが対応していない場合は、SamacSysに直接リクエスト可能です。

Diagram of ECAD Models

モデル

分類 タイトル 日時
モデル-SPICE ログインしてダウンロード TAR 32 KB
モデル-IBIS ZIP 10 KB
2件

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