特長
- Maximum ratings Power-supply voltage Vcc: 24 V Junction temperature Tj: – 40 to 125°C
- Electrical characteristics VREF output voltage VREF: 5.0 V ± 3% UVLO operation start voltage VH: 10.5 ± 0.9 V UVLO operation stop voltage VL: 9.0 ± 0.7 V PFC output maximum ON duty Dmax-out: 95% (typ.)
- Functions Constant power limit function Continuous conduction mode Hold function of PFC operation on momentary outage (PFC hold function) Overvoltage detection Overcurrent detection Soft start Feedback loop disconnection detection IC shutdown function Package lineup: SOP-16
説明
The R2A20111 is a power-factor correction (PFC) controller IC. This IC adopts continuous conduction mode as PFC operation. Various functions such as constant power limit, overvoltage detection, overcurrent detection, soft start, feedback-loop disconnection detection, and holding function of PFC operation through momentary outage (PFC hold function) are incorporated in a single chip. These functions reduce external circuitry. The constant power limit function allows to eliminate a significant amount of coil noise which is generated due to overcurrent detection operation in case of conventional overload. The PFC hold function enables quick recovery by continuing PFC operation after momentary outage. The hold time can be adjusted by an external capacitance. Overcurrent detection pin is separately provided. Latch mode shutdown function is incorporated. A soft-start control pin provides for the easy adjustment of soft-start operation, and can be used to prevent overshooting of the output voltage.
| Part Number | Status | Samples | Stock | RoHS | Package | Lead Count (#) | Pb (Lead) Free |
|---|---|---|---|---|---|---|---|
| R2A20111SP | Obsolete | N/A | Out of Stock | RoHS:EN RoHS:JA | SOP | 16# | Yes |
| R2A20111SP#U0 | Obsolete | N/A | Out of Stock | RoHS:EN RoHS:JA | SOP | 16# | Yes |
| R2A20111SP#W0 | Obsolete | N/A | Out of Stock | RoHS:EN RoHS:JA | SOP | 16# | Yes |
| R2A20111SP#W1 | Obsolete | N/A | Out of Stock | RoHS:EN RoHS:JA | SOP | 16# | Yes |
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- アプリケーションノート英語PDF 1.3 MB R19AN0015ED0102 Rev.1.02 2013年7月01日AI生成コンテンツ: The document provides layout recommendations and design rules for a dual port Ethernet PHY device supporting 10Base-T, 100Base-TX, and 100Base-FX. It covers strap pin configuration options for initial start-up settings, detailing the use of pull-up and pull-down resistors, including recommended resistor values and schematic examples. The strap pins function only during power-up or reset, with internal and external resistor configurations advised for noise immunity. Additional chapters address media interfaces, power supply layout, clock input, LED control, and unused pins.
- アプリケーションノート英語PDF 1.21 MB R19AN0014ED0102 Rev.1.02 2013年7月01日AI生成コンテンツ: The document provides layout recommendations and design rules for Dual PHY and Single Channel PHY ASSP devices. It covers strap pin configuration options for initial start-up settings, including pull-up and pull-down resistor values and configurations to ensure stable operation in noisy environments. The layout guidelines include power supply design, differential pair routing, media-dependent interfaces, MAC interfaces, and clock input circuits. Examples and tables illustrate resistor values and schematic configurations for strap pins.
- アプリケーションノート英語PDF 224 KB R03AN0009EJ0100 Rev.1.00 2012年2月22日AI生成コンテンツ: The document explains the internal functions of the R2A20112A IC, focusing on its UVLO block which prevents operation under low voltage, and the 5 V reference voltage used internally. It details the Error Amplifier that stabilizes PFC output voltage, the Zero Current Detection circuit essential for CRM operation, and the RAMP generator that controls PWM ON time using external components. The drive stage outputs pulses to power MOSFETs with specific peak current capabilities and includes driver circuit examples for different MOSFET gate charges.
- アプリケーションノート日本語AI生成コンテンツ: 本資料は、電源制御ICの電気特性や動作パラメータについて説明している。基準電圧、スイッチング周波数、電流検出などの内部機能や、誤差増幅器、ランプジェネレーター、過電流保護の役割を解説する。MOSFETのオン・オフタイミングや入力電圧、出力電圧、電流検出信号の関係も示されている。回路図により動作とタイミングが視覚的に示されている。
- アプリケーションノート英語PDF 397 KB an1684 2004年1月19日AI生成コンテンツ: The document outlines important legal disclaimers and usage guidelines for semiconductor products. It emphasizes user responsibility for product design and safety, disclaims liability for damages, and clarifies no intellectual property licenses are granted. Products are categorized by quality grades with specific application recommendations. Users must comply with laws, avoid unauthorized modifications, and ensure safe use within specified conditions. Contact details for Renesas Electronics sales offices worldwide are provided.
- アプリケーションノート英語PDF 509 KB an1681 2004年1月19日AI生成コンテンツ: The document explains grounding techniques for PCB layouts using a dual op amp example on a single-layer copper board. It compares three grounding schemes: a center spine ground trace, an outer ground plane, and a split/star ground plane, highlighting the benefits of single-point grounding to minimize noise and antenna effects. It emphasizes following current paths, minimizing loop lengths, and ensuring close forward and return paths to reduce interference. The document also includes disclaimers on product use, quality grades, safety, and legal compliance.
- テクニカルアップデート日本語PDF 110 KB TN-SPx-014A 2003年6月23日
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- アプリケーションノート英語PDF 1.3 MB R19AN0015ED0102 Rev.1.02 2013年7月01日AI生成コンテンツ: The document provides layout recommendations and design rules for a dual port Ethernet PHY device supporting 10Base-T, 100Base-TX, and 100Base-FX. It covers strap pin configuration options for initial start-up settings, detailing the use of pull-up and pull-down resistors, including recommended resistor values and schematic examples. The strap pins function only during power-up or reset, with internal and external resistor configurations advised for noise immunity. Additional chapters address media interfaces, power supply layout, clock input, LED control, and unused pins.
- アプリケーションノート英語PDF 1.21 MB R19AN0014ED0102 Rev.1.02 2013年7月01日AI生成コンテンツ: The document provides layout recommendations and design rules for Dual PHY and Single Channel PHY ASSP devices. It covers strap pin configuration options for initial start-up settings, including pull-up and pull-down resistor values and configurations to ensure stable operation in noisy environments. The layout guidelines include power supply design, differential pair routing, media-dependent interfaces, MAC interfaces, and clock input circuits. Examples and tables illustrate resistor values and schematic configurations for strap pins.
- アプリケーションノート英語PDF 224 KB R03AN0009EJ0100 Rev.1.00 2012年2月22日AI生成コンテンツ: The document explains the internal functions of the R2A20112A IC, focusing on its UVLO block which prevents operation under low voltage, and the 5 V reference voltage used internally. It details the Error Amplifier that stabilizes PFC output voltage, the Zero Current Detection circuit essential for CRM operation, and the RAMP generator that controls PWM ON time using external components. The drive stage outputs pulses to power MOSFETs with specific peak current capabilities and includes driver circuit examples for different MOSFET gate charges.
- アプリケーションノート日本語AI生成コンテンツ: 本資料は、電源制御ICの電気特性や動作パラメータについて説明している。基準電圧、スイッチング周波数、電流検出などの内部機能や、誤差増幅器、ランプジェネレーター、過電流保護の役割を解説する。MOSFETのオン・オフタイミングや入力電圧、出力電圧、電流検出信号の関係も示されている。回路図により動作とタイミングが視覚的に示されている。
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製品通知（PCN、EOLなど） (4)
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