特長
- Fully Integrated PLL
- Up to 200MHz I/O Frequency
- LVCMOS Outputs
- Outputs Disable in High Impedance
- LVPECL Reference Clock Options
- LQFP Packaging
- ±50ps Cycle–Cycle Jitter
- 150ps Output Skews
MPC961P - Block Diagram
説明
The MPC961 is a 2.5V or 3.3V compatible, 1:18 PLL based zero delay buffer. With output frequencies of up to 200MHz, output skews of 150ps the device meets the needs of the most demanding clock tree applications.
| Part Number | Status | Samples | Stock | Package | Lead Count (#) | Carrier Type | Moisture Sensitivity Level (MSL) | Core Voltage (V) | C-C Jitter Max P-P (ps) | Input Type | Output Voltage (V) | Qty. per Reel (#) | Qty. per Carrier (#) | Pb (Lead) Free | Pb Free Category | Temp. Range (°C) |
|---|---|---|---|---|---|---|---|---|---|---|---|---|---|---|---|---|
| MPC961PAC | Obsolete | N/A | In Stock | TQFP | 32# | Tray | 3 | 2.5V, 3.3V | 15ps | LVCMOS | 2.5V, 3.3V | 0 | 250# | Yes | e3 Sn | 0 to 70°C |
| MPC961PACR2 | Obsolete | N/A | In Stock | TQFP | 32# | Reel | 3 | 3.3V, 2.5V | 50ps | LVPECL | 3.3V, 2.5V | 2000# | 0 | Yes | e3 Sn | 0 to 70°C |
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