特長
- Adjustable Resonant Delay for ZVS Operation
- Voltage- or Current-Mode Operation
- 3% Current Limit Threshold
- 175µA Startup Current
- Supply UVLO
- Adjustable Deadtime Control
- Adjustable Soft-Start
- Adjustable Oscillator Frequency Up to 2MHz
- Tight Tolerance Error Amplifier Reference Over Line, Load, and Temperature
- 5MHz GBWP Error Amplifier
- Adjustable Cycle-by-Cycle Peak Current Limit
- Fast Current Sense to Output Delay
- 70ns Leading Edge Blanking
- Multi-Pulse Suppression
- Buffered Oscillator Sawtooth Output
- Internal Over Temperature Protection
- Pb-Free Plus Anneal Available and ELV, WEEE, RoHS Compliant
ISL6753 Functional Diagram
説明
The ISL6753 is a high-performance, low-pin-count alternative, zero-voltage switching (ZVS) full-bridge PWM controller. Like the ISL6551, it achieves ZVS operation by driving the upper bridge FETs at a fixed 50% duty cycle while the lower bridge FETS are trailing-edge modulated with adjustable resonant switching delays. Compared to the more familiar phase-shifted control method, this algorithm offers equivalent efficiency and improved overcurrent and lightload performance with less complexity in a lower pin count package. This advanced BiCMOS design features low operating current, adjustable oscillator frequency up to 2MHz, adjustable soft-start, internal over temperature protection, precision deadtime and resonant delay control, and short propagation delays. Additionally, Multi-Pulse Suppression ensures alternating output pulses at low duty cycles where pulse skipping may occur.
アプリケーション
- ZVS Full-Bridge Converters
- Telecom and Datacom Power
- Wireless Base Station Power
- File Server Power
- Industrial Power Systems
| Part Number | Status | Samples | Stock | RoHS | Package | Lead Count (#) | Carrier Type | Moisture Sensitivity Level (MSL) | Pb (Lead) Free | Pb Free Category | Temp. Range (°C) |
|---|---|---|---|---|---|---|---|---|---|---|---|
| ISL6753AAZA | Obsolete | N/A | In Stock | RoHS:EN | QSOP | 16# | Tube | 2 | Yes | Pb-Free 100% Matte Tin Plate w/Anneal-e3 | -40 to +105°C |
| ISL6753AAZA-T | Obsolete | N/A | In Stock | RoHS:EN | QSOP | 16# | Reel | 2 | Yes | Pb-Free 100% Matte Tin Plate w/Anneal-e3 | -40 to +105°C |
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- 製品変更通知英語PDF 398 KB PCN15046 2016年1月07日
- アプリケーションノート英語PDF 581 KB an1262 2006年7月31日AI生成コンテンツ: The document explains the operation and design considerations of ZVS full-bridge controllers using ISL6752 and ISL6753 ICs. It details the conduction and switching losses of MOSFETs, emphasizing the zero voltage switching of upper MOSFETs and the impact of device characteristics on efficiency. The synchronous rectifier timing setup is described, including methods to avoid cross conduction and improve efficiency. It also discusses rectifier output options, highlighting the limitations of Schottky and PN diodes and the need for voltage snubbing networks to manage voltage ringing.
- アプリケーションノート英語PDF 725 KB an1246 2005年11月02日AI生成コンテンツ: This document explains techniques to improve Zero Voltage Switching (ZVS) full-bridge converter performance by analyzing MOSFET power losses and introducing saturable cores. It details how saturable cores enhance ZVS operation by varying inductance based on magnetic saturation, improving blocking time and reducing output diode ringing. The theory covers magnetic B-H loops, core geometry, permeability changes, and core reset mechanisms influenced by diode reverse recovery characteristics.
- アプリケーションノート英語PDF 397 KB an1684 2004年1月19日AI生成コンテンツ: The document outlines important legal disclaimers and usage guidelines for semiconductor products. It emphasizes user responsibility for product design and safety, disclaims liability for damages, and clarifies no intellectual property licenses are granted. Products are categorized by quality grades with specific application recommendations. Users must comply with laws, avoid unauthorized modifications, and ensure safe use within specified conditions. Contact details for Renesas Electronics sales offices worldwide are provided.
- アプリケーションノート英語PDF 509 KB an1681 2004年1月19日AI生成コンテンツ: The document explains grounding techniques for PCB layouts using a dual op amp example on a single-layer copper board. It compares three grounding schemes: a center spine ground trace, an outer ground plane, and a split/star ground plane, highlighting the benefits of single-point grounding to minimize noise and antenna effects. It emphasizes following current paths, minimizing loop lengths, and ensuring close forward and return paths to reduce interference. The document also includes disclaimers on product use, quality grades, safety, and legal compliance.
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- アプリケーションノート英語PDF 725 KB an1246 2005年11月02日AI生成コンテンツ: This document explains techniques to improve Zero Voltage Switching (ZVS) full-bridge converter performance by analyzing MOSFET power losses and introducing saturable cores. It details how saturable cores enhance ZVS operation by varying inductance based on magnetic saturation, improving blocking time and reducing output diode ringing. The theory covers magnetic B-H loops, core geometry, permeability changes, and core reset mechanisms influenced by diode reverse recovery characteristics.
- アプリケーションノート英語PDF 397 KB an1684 2004年1月19日AI生成コンテンツ: The document outlines important legal disclaimers and usage guidelines for semiconductor products. It emphasizes user responsibility for product design and safety, disclaims liability for damages, and clarifies no intellectual property licenses are granted. Products are categorized by quality grades with specific application recommendations. Users must comply with laws, avoid unauthorized modifications, and ensure safe use within specified conditions. Contact details for Renesas Electronics sales offices worldwide are provided.
- アプリケーションノート英語PDF 509 KB an1681 2004年1月19日AI生成コンテンツ: The document explains grounding techniques for PCB layouts using a dual op amp example on a single-layer copper board. It compares three grounding schemes: a center spine ground trace, an outer ground plane, and a split/star ground plane, highlighting the benefits of single-point grounding to minimize noise and antenna effects. It emphasizes following current paths, minimizing loop lengths, and ensuring close forward and return paths to reduce interference. The document also includes disclaimers on product use, quality grades, safety, and legal compliance.
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