特長
- Clock frequencies up to 100 MHz (6.5ns access time)
- Select IDT Standard timing or First Word Fall Through Timing
- Programmable Almost-Empty and Almost-Full flags
- each has three default offsets (8, 16 and 64)
- Port B bus sizing of 36 bits (long word), 18 bits (word) and 9 bits
- Big- or Little-Endian format for word and byte bus sizes
- Mailbox bypass registers for each FIFO
- Free-running CLKA and CLKB may be asynchronous or coincident
- Auto power down minimizes power dissipation
- Available 128-pin TQFP package
- Industrial temperature range (–40C to +85C) is available
72V3624 - Block Diagram
説明
The 72V3624 is a 3.3V version of the IDT723624. Two independent 256 x 36 dual-port SRAM FIFOs on board each chip buffer data in opposite directions.
| Part Number | Status | Samples | Stock | Package | Lead Count (#) | Temp. Grade | Pb (Lead) Free | Carrier Type |
|---|---|---|---|---|---|---|---|---|
| 72V3624L10PF | Obsolete | N/A | Out of Stock | TQFP | 128# | C | No | Tray |
| 72V3624L10PF8 | Obsolete | N/A | Out of Stock | TQFP | 128# | C | No | Reel |
| 72V3624L15PF | Obsolete | N/A | Out of Stock | TQFP | 128# | C | No | Tray |
| 72V3624L15PF8 | Obsolete | N/A | Out of Stock | TQFP | 128# | C | No | Reel |
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