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| 型名 | 状態 | サンプル | 在庫 | RoHS | パッケージ | Bit Size | RAM (KB) | Lead Count (#) | Operating Freq (Max) (MHz) | CPU | DMA | Timer | Ethernet | Temp. Range (°C) |
|---|---|---|---|---|---|---|---|---|---|---|---|---|---|---|
| M34286G2-XXXGP#V2 | Obsolete | N/A | 在庫切れ | RoHS:EN RoHS:JA | LSSOP | 4 | 0.0625KB | 20# | 4MHz | 720 | No | 8-bit x 2-ch | No | -40 to +85 |
| M34286G2-XXXGP#X6 | Obsolete | N/A | 在庫切れ | RoHS:EN RoHS:JA | LSSOP | 4 | 0.0625KB | 20# | 4MHz | 720 | No | 8-bit x 2-ch | No | -40 to +85 |
| M34286G2GP#V2 | Obsolete | N/A | 在庫あり | RoHS:EN RoHS:JA | LSSOP | 4 | 0.0625KB | 20# | 4MHz | 720 | No | 8-bit x 2-ch | No | -40 to +85 |
| M34286G2GP#X6 | Obsolete | N/A | 在庫切れ | RoHS:EN RoHS:JA | LSSOP | 4 | 0.0625KB | 20# | 4MHz | 720 | No | 8-bit x 2-ch | No | -40 to +85 |
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- アプリケーションノート英語AI生成コンテンツ: The document details the differences between the 4286 and 4283 groups, highlighting performance variations such as instruction count, execution times, I/O port functions, and operating temperature ranges. It explains pin configurations, control register differences, and added instructions exclusive to the 4286 group, including new clock division commands and voltage detection changes. Reference datasheets and technical updates are recommended for the latest information.
- アプリケーションノート日本語PDF 359 KB RJJ05B1326-0100 Rev.1.00 2008年8月26日AI生成コンテンツ: 本資料は4286グループのマイコンにおけるLVDおよびクロック制御の設定方法を説明します。分周命令（CCK、CCK2、CCK4）によるシステムクロック選択と命令クロック周波数への影響を詳細に解説し、クロック制御回路の構成を示します。分周命令は一度のみ実行可能であることを強調しています。また、CLVD命令の実行によりリセット発生電圧が1.5Vから1.7Vに変化するLVD動作と電圧低下検出波形も示しています。
- アプリケーションノート英語PDF 125 KB REJ05B1237-0100 Rev.1.00 2008年8月26日AI生成コンテンツ: The document explains how to configure the LVD (Low Voltage Detection) and clock control for the 4286-group microcomputer. It details system clock selection using frequency divide instructions (CCK, CCK2, CCK4) and their effects on instruction and system clocks. The clock control circuit configuration is illustrated, emphasizing that frequency divide instructions execute only once. The LVD section describes how executing the CLVD instruction adjusts the reset voltage threshold from 1.5 V to 1.7 V, with timing details shown in the voltage-down detection waveform.
- アプリケーションノート英語PDF 154 KB REJ05B1113-0100 Rev.1.00 2007年12月28日AI生成コンテンツ: The document explains how to configure a staircase key matrix using 3-point switches for the 4283 group microcomputers operating at 4.0 MHz. It details the bit assignments and control procedures for related registers, including Timer Control Register V1 and Pulldown Control Registers PU0 and PU1. The instructions cover writing values to these registers using specific instructions to enable or disable features such as timer control and pull-down transistor activation for key-on wakeup functionality.関連ファイル：
- テクニカルアップデート英語PDF 32 KB TN-4500-01-9501 1995年1月01日
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- アプリケーションノート日本語PDF 359 KB RJJ05B1326-0100 Rev.1.00 2008年8月26日AI生成コンテンツ: 本資料は4286グループのマイコンにおけるLVDおよびクロック制御の設定方法を説明します。分周命令（CCK、CCK2、CCK4）によるシステムクロック選択と命令クロック周波数への影響を詳細に解説し、クロック制御回路の構成を示します。分周命令は一度のみ実行可能であることを強調しています。また、CLVD命令の実行によりリセット発生電圧が1.5Vから1.7Vに変化するLVD動作と電圧低下検出波形も示しています。
- アプリケーションノート英語PDF 125 KB REJ05B1237-0100 Rev.1.00 2008年8月26日AI生成コンテンツ: The document explains how to configure the LVD (Low Voltage Detection) and clock control for the 4286-group microcomputer. It details system clock selection using frequency divide instructions (CCK, CCK2, CCK4) and their effects on instruction and system clocks. The clock control circuit configuration is illustrated, emphasizing that frequency divide instructions execute only once. The LVD section describes how executing the CLVD instruction adjusts the reset voltage threshold from 1.5 V to 1.7 V, with timing details shown in the voltage-down detection waveform.
- アプリケーションノート英語PDF 154 KB REJ05B1113-0100 Rev.1.00 2007年12月28日AI生成コンテンツ: The document explains how to configure a staircase key matrix using 3-point switches for the 4283 group microcomputers operating at 4.0 MHz. It details the bit assignments and control procedures for related registers, including Timer Control Register V1 and Pulldown Control Registers PU0 and PU1. The instructions cover writing values to these registers using specific instructions to enable or disable features such as timer control and pull-down transistor activation for key-on wakeup functionality.関連ファイル：
アプリケーションノート、ホワイトペーパー (4)
製品通知（PCN、EOLなど） (3)
- テクニカルアップデート英語PDF 32 KB TN-4500-01-9501 1995年1月01日
エラッタ、テクニカルアップデート (5)
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FAQ 105025 : 【低消費電力機構】キーオンウェイクアップの復帰条件はエッジか、レベルか？ [2003/07/04]
... アップモードに遷移すると、すぐに復帰します。 復帰条件に関してはデータシートをご参照ください。 (#101945) 適用製品 4286
