
クロック分周器は、入力信号を分周したクロック信号を出力します。信号のバッファリングや信号の複製(複数の複製が可能)を行う目的で使うこともできます。クロック分周器は、1分周モードで使うとファンアウトバッファとして機能します。
Renesasが提供する「8」シリーズのファンアウトバッファ/クロック分周器は、I/Oの仕様がシングルエンドの製品であっても、デバイスの内部では完全な差動構成を採用しています。そのため、コモンモードノイズが除去され、優れたジッター/出力スキュー性能が得られます。差動回路は定電流源をベースとしているので、シングルエンドのソリューションに比べてシステムの電源に混入する雑音が少なく、EMI(電磁干渉)規格への準拠が容易になります。
Function |
Outputs (#) |
Output Type |
Output Freq Range (MHz) |
Input Freq (MHz) |
Inputs (#) |
Input Type |
Output Banks (#) |
Core Voltage (V) |
Output Voltage (V) |
Divider Value |
Output Skew (ps) |
Additive Phase Jitter Typ RMS (fs) |
Pkg. Dimensions (mm) |
Temp. Range |
Pkg. Type |
Lead Count (#) |
105°C Max. Case Temp. |
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型名 | ||||||||||||||||||
Programmable Low Additive Jitter 2:8 Buffer with Dividers and Universal Outputs | Buffer, Divider | 8 | CML, HCSL, LVDS, LVPECL | 0.000001 - 700 | 0.000001 - 700 | 2 | LVCMOS, LVDS, LVHSTL, LVPECL | 2 | 1.8, 2.5, 3.3 | 1.5, 1.8, 2.5, 3.3 | 2, 511 | 100 | 60 | 5.0 x 5.0 x 0.9 | -40 to 85°C | VFQFPN | 32 |
Description
Overview of IDT's single-ended fanout buffers and single-ended fanout dividers. Fanout buffers are a useful building block of many clock trees, providing signal buffering and multiple low-skew copies of the input signal. The clock fanout from a single input reduces loading on the preceding driver and provides an efficient clock distribution network. Presented by Vik Chaudhry, technical marketing manager at IDT. For more information about IDT's rich portfolio of clock IC timing solutions, visit www.idt.com/go/clocks.
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