Evaluation Kit for 9FGV1002 Programmable PhiClock™ Generator
This is the evaluation board for the 9FGV1002 programmable PhiClockTM generator. It provides a convenient way of configuring and programming the blank parts for the...
概要
説明
The 9FGV1002 is a member of Renesas' PhiClock™ programmable clock generator family. The 9FGV1002 provides four spread-spectrum copies of a single output frequency and two copies of the crystal reference input. Two select pins allow for hardware selection of the desired configuration, or two I²C bits all easy software selection of the desired configuration. The user may configure any one of the four OTP configurations as the default when operating in I²C mode. Four unique I²C addresses are available, allowing easy I²C access to multiple components.
特長
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PCIe Gen1–6 compliant
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PCIe Gen6 Common Clock jitter < 50fs RMS
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276fs RMS typical phase jitter at 156.25MHz (12kHz–20MHz)
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4 programmable output pairs plus 2 LVCMOS REF outputs
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1 integer, fractional or spread-spectrum output frequency per configuration
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1MHz–325MHz output frequency (LVDS or LP-HCSL)
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1MHz–200MHz output frequency (LVCMOS)
- 1.8V to 3.3V core VDD
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Individual 1.8V, 2.5V or 3.3V VDDO for each programmable output pair
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Supports HCSL, LVDS and LVCMOS I/O standards
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Supports AC-coupled LVPECL and CML logic – see AN-891
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4 × 4 mm 24-VFQFPN and 24-LGA packages with 50MHz integrated crystal option
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Supported by Timing Commander™ software
ドキュメント
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日付 | |
|---|---|---|
| PDF 481 KB | データシート | |
| PDF 91 KB | アプリケーションノート | |
| PDF 1.16 MB | アプリケーションノート | |
| PDF 734 KB | 製品変更通知 | |
| PDF 2.40 MB | 概要 | |
| PDF 1.99 MB | アプリケーションノート | |
| PDF 256 KB | アプリケーションノート | |
| PDF 129 KB | 製品変更通知 | |
| PDF 150 KB | データシート | |
| PDF 150 KB | データシート | |
| PDF 150 KB | データシート | |
| PDF 150 KB | データシート | |
| PDF 150 KB | データシート | |
| PDF 150 KB | データシート | |
| PDF 143 KB | 製品変更通知 | |
| PDF 134 KB | アプリケーションノート | |
| PDF 222 KB | アプリケーションノート | |
| PDF 507 KB | その他資料 | |
| PDF 401 KB | マニュアル－ソフトウェア | |
| PDF 255 KB | アプリケーションノート | |
| PDF 307 KB | アプリケーションノート | |
| PDF 480 KB | アプリケーションノート | |
| PDF 235 KB | アプリケーションノート | |
| PDF 1.90 MB | アプリケーションノート | |
| PDF 495 KB | アプリケーションノート | |
| PDF 442 KB | アプリケーションノート | |
| PDF 233 KB | アプリケーションノート | |
| PDF 160 KB | アプリケーションノート | |
| PDF 120 KB | アプリケーションノート | |
| PDF 565 KB | アプリケーションノート | |
| PDF 136 KB | アプリケーションノート | |
31 items
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設計・開発
ソフトウェア／ツール
ボード＆キット
ボード＆キット
モデル
ECADモデル
[製品選択]テーブル内の製品名をクリックするとSamacSysが提供する回路図シンボル、PCBフットプリント、3D CADモデルがご確認いただけます。 お探しのシンボルやモデルが見つからない場合、Webサイトから直接リクエストできます。
本デバイスは、ルネサス事業所でのプログラム書き込みが可能です。カスタムプログラムユーティリティをお試しください。
Processing table
Pkg. Type |
Supply Voltage (V) |
Output Impedance |
Xtal Freq (MHz) |
Carrier Type |
ご購入 / サンプル |
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|---|---|---|---|---|---|---|
| 型名 | ||||||
| VFQFPN | 3.3 | 100 | 25 | Tray | サンプルを入手, | |
| VFQFPN | 3.3 | 100 | 25 | Reel | ||
| VFQFPN | 1.8 | 100 | 25 | Tray | サンプルを入手, | |
| VFQFPN | 1.8 | 100 | 25 | Reel | ||
| VFQFPN | 85 | 25 | Tray | サンプルを入手, | ||
| VFQFPN | 3.3 | 85 | 25 | Reel | ||
| LGA | 100 | 50 | Tray | サンプルを入手, | ||
| LGA | 3.3 | 100 | 50 | Reel | ||
| LGA | 1.8 | 100 | 50 | Tray | サンプルを入手, | |
| LGA | 1.8 | 100 | 50 | Reel | ||
| LGA | 3.3 | 85 | 50 | Tray | サンプルを入手, | |
| LGA | 3.3 | 85 | 50 | Reel |
Tips for Using This Parametric Table:
- Hide Filters button in header: Collapse or expands filters
- Column sort buttons in header: Sort Column alphabetically / numerically descending or ascending
- Reset button in header: Reset all filters to the page default
- Full Screen button in header: Expand the table to full screen view (user must close out of full screen before they can interact with rest of page)
- Export button in header: Export the filtered results of the table to an Excel document
- Filter parts search bar in header: Type to filter table results by part number
- Hide column button in column headers: Select to hide columns in table
- AND / OR toggle switches in header: Toggles the logic of this particular filter to be “AND” or “OR” logic for filtering results
- Multiselect checkboxes at beginning of each row in table: Select these checkboxes to compare products against each other
- Document icon next to product name in row: View the featured document for this product
- Chip icon next to the right of the document icon in row: View the block diagram for this product
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サポート
Renesas Samples
本デバイスは、ルネサス事業所でのプログラム書き込みが可能です。カスタムプログラムユーティリティをお試しください。
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| 発注型名 | サンプル |
|---|---|
| 9FGV1002C001NBGI | Availability |
| 9FGV1002C002NBGI | Availability |
| 9FGV1002C015NBGI | Availability |
| 9FGV1002CQ505LTGI | Availability |
| 9FGV1002CQ506LTGI | Availability |
| 9FGV1002CQ515LTGI | Availability |
play_circle_filledビデオ&トレーニング
PCIe Reference Clock Jitter Budgets
IDT’s chief PCIe system architect explains the fundamental difference in reference clock jitter budgets between the first three generations of the specification and those of Gen4 and Gen5 which raise new challenges for designers.
Video List
