概要
説明
The ISL54105A is a high-performance TMDS timing regenerator containing a programmable equalizer and a clock data recovery (CDR) function for each of the three TMDS pairs in an HDMI or DVI signal. The TMDS data outputs of the ISL54105A are regenerated and perfectly aligned to the regenerated TMDS clock signal, creating an extremely clean, low-jitter DVI/HDMI signal that can be easily decoded by any TMDS receiver. The ISL54105A can be used as a cable extender, to clean up a noisy/jittery TMDS source, or to provide a very stable TMDS signal to a finicky DVI or HDMI receiver.
特長
- Clock data recovery and retiming
- Programmable pre-emphasis on output driver
- Programmable internal 50Ω, 100Ω or high-Z termination
- Stand-alone or I2C software-controlled operation
- 72 lead, 10mm x 10mm QFN package
- Pb-free (RoHS compliant)
製品比較
アプリケーション
ドキュメント
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分類 | タイトル | 日時 |
データシート | PDF 2.78 MB | |
製品変更通知 | PDF 197 KB | |
EOL通知 | PDF 1.17 MB | |
価格変更のお知らせ | PDF 208 KB | |
4件
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設計・開発
ボード&キット
Transition Minimized Differential Signaling (TMDS) Regenerator Evaluation Kits
The ISL54105ACRZ-EVALZ 1:1 high-performance transition minimized differential signaling (TMDS) signal multiplexer/regenerator/retimer evaluation kit is used to evaluate the ISL54105A TMDS regenerators.
The high-performance TMDS ISL54105A timing regenerator contains a programmable equalizer...
モデル
ECADモデル
SamacSysの回路図シンボル、PCBフットプリント、および3D CADモデルは、製品オプションテーブルのCADモデルリンクをクリックすることで参照できます。シンボルまたはモデルが対応していない場合は、SamacSysに直接リクエスト可能です。

製品選択
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