The 5L35023 is a VersaClock programmable clock generator and is designed for low power, consumer, and high performance PCI Express applications. The 5L35023 device is a three PLL architecture design, and each PLL is individually programmable and allowing for up to five unique frequency outputs.

The 5L35023 has built-in unique features such as Proactive Power Saving (PPS), Performance-Power Balancing (PPB), Overshot Reduction Technology (ORT) and Extreme Low Power DCO. An internal OTP memory allows the user to store the configuration in the device without programming after power up, then program the 5L35023 again through the I²C interface.

The device has programmable VCO and PLL source selection to allow the user to do power-performance optimization base on the application requirements. It also supports three single-ended output and two pair of differential outputs that support LVCMOS and LPHCSL. A Low Power 32.768kHz clock is supported with only less than 2μA current consumption for system RTC reference clock.
 

特長

  • Configurable OE pin function as OE, PD#, PPS or DFC control function
  • Configurable PLL bandwidth/minimizes jitter peaking
  • PPS: Proactive Power Saving features save power during the end device power down mode
  • PPB: Performance- Power Balancing feature allows minimum power consumption base on required performance
  • DFC: Dynamic Frequency Control feature allows up to 4 difference frequencies switch dynamically
  • Features < 65µA ultra-power-down
  • Outputs: 1MHz to 125MHz
  • Spread Spectrum clock support to lower system EMI
  • I²C interface

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This device is factory-configurable. Try the Custom Part Configuration Utility.
製品名 Part Status Pkg. Type Lead Count (#) Temp. Grade Pb (Lead) Free Carrier Type 購入/サンプル
Active VFQFPN 24 I はい Tray
Availability
Active VFQFPN 24 I はい Reel
Availability

製品比較

5L35023 5L35021 5P35021 5P35023
Inputs (#) 1 1 1 1
Output Type LP-HCSL, LVCMOS LP-HCSL, LVCMOS LP-HCSL, LVCMOS, LVDS, LVPECL LP-HCSL, LVCMOS, LVDS, LVPECL
Core Voltage (V) 1.8 1.8 3.3 3.3
Output Voltage (V) 1.8 1.8 1.8, 2.5, 3.3 1.8, 2.5, 3.3
Pkg. Dimensions (mm) 4.0 x 4.0 x 0.9 3.0 x 3.0 x 1.0 3.0 x 3.0 x 1.0 4.0 x 4.0 x 0.9

descriptionドキュメント

タイトル language 分類 形式 サイズ 日付
データシート
star 5L35023 Datasheet データシート PDF 630 KB
ユーザーガイド、マニュアル
Timing Commander Installation Guide ガイド PDF 497 KB
アプリケーションノート、ホワイトペーパー
How to Make 1.2V LVCMOS from 1.8V LVCMOS Output アプリケーションノート PDF 256 KB
AN-909 PCB Layout Considerations for Designing IDT VersaClock 3S, 5 and 6 Clock Products アプリケーションノート PDF 901 KB
AN-918 Programmable Clocks vs Crystal Oscillators アプリケーションノート PDF 307 KB
AN-891 Driving LVPECL, LVDS, CML, and SSTL Logic with IDT Universal Low-Power HCSL Outputs アプリケーションノート PDF 480 KB
AN-844 Termination - AC Coupling Clock Receivers アプリケーションノート PDF 170 KB
AN-845 Termination - LVCMOS アプリケーションノート PDF 146 KB
AN-846 Termination - LVDS アプリケーションノート PDF 133 KB
AN-842 Thermal Considerations in Package Design and Selection アプリケーションノート PDF 495 KB
AN-815 Understanding Jitter Units アプリケーションノート PDF 565 KB
AN-806 Power Supply Noise Rejection アプリケーションノート PDF 438 KB
AN-808 PCI Express/HCSL Termination アプリケーションノート PDF 137 KB
PCN / PDN
PCN# : TB1912-02(R1) Convert Shipping Media
from Tube or Tray to Cut Reel
製品変更通知 PDF 5.71 MB
PCN# : TB1912-02 Convert Shipping Media
from Tube or Tray to Cut Reel
製品変更通知 PDF 5.61 MB
PCN# : TP1910-01 VBAT Power Domain Required 製品変更通知 PDF 110 KB
PCN# : A1904-01 Add Greatek, Taiwan as an Alternate Assembly Facility 製品変更通知 PDF 983 KB
その他資料
VersaClock Family of Programmable Clocks Overview (Japanese) English 概要 PDF 1.31 MB
IDT Clock Generation Overview (Japanese) English 概要 PDF 2.19 MB
IDT Clocks for Altera's Stratix V and Arria V/X FPGAs 技術概要 PDF 238 KB

file_downloadダウンロード

タイトル language 分類 形式 サイズ 日付
ソフトウェア
VersaClock 3S Timing Commander Personality File ソフトウェア/ツール-その他 ZIP 5.80 MB
Timing Commander Installer (v1.16.4) ソフトウェア/ツール-その他 ZIP 19.79 MB
モデル
5L35023 IBIS Model モデル-IBIS ZIP 27 KB

memoryボード&キット

製品名 タイトル 分類 Company
DEV5L35023 5L35023 VersaClock 3S Programmable Clock Development Kit Development Renesas