
ClockMatrixデバイスファミリは、インタフェース速度が最大800 Gbpsのアプリケーションでクロック設計を簡素化する、高性能かつ高精度のタイミングソリューションです。
ClockMatrixデバイスはシステム内の任意の場所に設置して、クロック発生、周波数変換、ジッタ減衰、位相アライメントなどの重要なタイミング機能を実行できます。デバイスはワイヤレスベースバンド、DU、CU、RU、フロントホールまたはバックホールネットワーク上のIEEE 1588タイムスタンプユニット(TSU)とSyncEポートを正確に同期させるために使用することができます。 このデバイスのファミリは複数の独立したタイミングチャネルをサポートしています。このサポートには、IEEE 1588クロックの合成、SyncEクロックの生成、ジッタの減衰、コンバータのSYSREF生成を含む無線クロックの生成があります。 入力から入力、入力から出力、出力から出力の位相スキューをすべて正確に管理できます。 デバイスは最大112GbpsのSERDES、CPRI/OBSAI、SONET/SDH ADC/DAC、IEEE 1588 TSUなどを直接同期させることができる超低ジッタクロックを出力します。 IEEE 1588システムでの同期を容易に実現するために、ルネサスはPTPクロックマネージャソフトウェアをライセンスに基づき無償で提供しています。
主に次のような特徴があります。
主なテクニカルドキュメント: ClockMatrix Family Overview
日付 | ||
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PDF 164 KB | アプリケーションノート | |
PDF 1.57 MB | アプリケーションノート | |
PDF 275 KB | アプリケーションノート | |
XLSX 321 KB | その他資料 | |
PDF 936 KB | ガイド | |
PDF 320 KB | 概要 | |
PDF 1.92 MB | アプリケーションノート | |
PDF 692 KB | アプリケーションノート | |
PDF 2.13 MB | アプリケーションノート | |
PDF 10.53 MB | ガイド | |
PDF 231 KB | アプリケーションノート | |
PDF 552 KB | アプリケーションノート | |
PDF 385 KB | アプリケーションノート | |
PDF 272 KB | アプリケーションノート | |
PDF 304 KB | アプリケーションノート | |
PDF 486 KB | マニュアル-ハードウェア | |
PDF 880 KB | アプリケーションノート | |
PDF 584 KB | アプリケーションノート | |
PDF 162 KB | アプリケーションノート | |
PDF 550 KB | アプリケーションノート | |
PDF 739 KB | アプリケーションノート | |
PDF 633 KB | アプリケーションノート | |
PDF 479 KB | アプリケーションノート | |
PDF 442 KB | アプリケーションノート | |
PDF 566 KB | アプリケーションノート | |
PDF 976 KB | アプリケーションノート | |
PDF 659 KB | アプリケーションノート | |
27 items
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日付 | ||
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ZIP 615 KB | ソフトウェア/ツール-ソフトウェア | |
ZIP 73 KB | ソフトウェア/ツール-その他 | |
ZIP 1.73 MB | ソフトウェア/ツール-その他 | |
PDF 488 KB | ソフトウェア/ツール-その他 | |
PDF 222 KB | ソフトウェア/ツール-その他 | |
ZIP 177 KB | ソフトウェア/ツール-その他 | |
ZIP 177 KB | ソフトウェア/ツール-その他 | |
7 items
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The ClockMatrix™ 2 family of devices are high-performance, precision timing solutions designed to simplify clock designs for applications with up to 800Gbps interface speeds. This second-generation family delivers improved performance with phase jitter as low as 88fs RMS. The highly integrated devices serve as full-function IEEE 1588 synchronization clocks and ultra-low jitter reference clocks for synchronous Ethernet PHYs with data rates up to 112Gbps PAM-4, reducing design complexity and bill of materials (BOM). Visit renesas.com/clockmatrix to learn more.
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