Low skew, low jitter PLL clock driver; 1 to 5 differential clock distribution (SSTL_18)

特長

  • Feedback pins for input to output synchronization
  • Spread Spectrum tolerant inputs
  • Auto PD when input signal is at a certain logic state

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製品名 Part Status Pkg. Type Lead Count (#) Temp. Grade Pb (Lead) Free Carrier Type 購入/サンプル
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descriptionドキュメント

タイトル language 分類 形式 サイズ 日付
データシート
star 97ULP845A Datasheet データシート PDF 329 KB
PCN / PDN
PLC# : 210007 End-of-Life (EOL) Process on Select Part Numbers Product Life Cycle Notice PDF 160 KB
PDN# : CQ-14-02R2 製品中止通知 PDF 549 KB
PDN# : CQ-14-02R1 PRODUCT DISCONTINUANCE NOTICE 製品中止通知 PDF 545 KB
PDN# : CQ-14-02 PRODUCT DISCONTINUANCE NOTICE 製品中止通知 PDF 544 KB
PCN#: A1309-03 Additional Assembly Sources 製品変更通知 PDF 398 KB