従来の10倍の画像処理能力!セキュリティ機能強化で安心・安全なネットワーク接続を実現。画像認識アプリのキーデバイス

RZ/A2Mは、HMI(ヒューマン・マシン・インタフェース)、中でもカメラを使ったアプリケーションに適しています。モバイル機器で広く使われているMIPIカメラインタフェースに対応し、入力画像を高速処理するDRP(Dynamically Reconfigurable Processor)を搭載。またイーサネットを2チャネル搭載するとともに、暗号ハードウェアアクセラレータによりセキュリティを強化。安心かつ安全な高速ネットワーク接続が可能になり、家電から産業機器まで幅広いシステムの画像認識アプリケーションに適用できます。

特長

項目 RZ/A2M
品名/用途/パッケージ 176 ピン R7S921040VCBG
Industry usage etc.
176-ピンBGA (13mm×13mm)
0.8mm ピッチ
256 ピン R7S921041VCBG
Industry usage etc.
256-ピンBGA (11mm×11mm)
0.5mm ピッチ
R7S921051VCBG
Industry usage etc.
256-ピンBGA (11mm×11mm)
0.5mm ピッチ
272 ピン R7S921042VCBG
Industry usage etc.
272-ピンBGA (17mm×17mm)
0.8mm ピッチ
R7S921052VCBG
Industry usage etc.
272-ピンBGA (17mm×17mm)
0.8mm ピッチ
324 ピン R7S921043VCBG
Industry usage etc.
324-ピンBGA (19mm×19mm)
0.8mm ピッチ
R7S921053VCBG
Industry usage etc.
324-ピンBGA (19mm×19mm)
0.8mm ピッチ
電源電圧 3.3V/1.8V/1.2V
最大動作周波数 528MHz
CPUコア Arm® Cortex®-A9 (with Jazelle® and NEON搭載)
内蔵RAM 大容量メモリ:4Mバイト
(ビデオ表示用/ワーク領域用、内128Kバイトをデータ保持用と共用)
キャッシュメモリ 1次キャッシュメモリ:64Kバイト (命令32K/データ32K分離、TLB128エントリ)
2次キャッシュメモリ:128Kバイト (CoreLink Level 2 Cache Controller L2C-310搭載)
外部メモリ バスクロック最大132MHz
バスステートコントローラにより、SRAM、バイト選択付きSRAM、SDRAM、バーストROM (クロック同期/クロック非同期) との直結が可能。
また、アドレス/データマルチプレクスI/O (MPX) インタフェースをサポート。
アドレス空間:64 Mバイト x6
データバス幅:外部8/16ビット
グラフィックス機能 ビデオディスプレイコントローラ (1チャネルの映像入力と1チャネルのパネル出力対応 (LVDS対応))
スプライトエンジン
キャプチャエンジンユニット (CMOSカメラインタフェース)
歪み補正エンジン ×1 チャネル (守秘契約要)
2D描画エンジン
MIPI CSI-2 インタフェース
JPEGコーデックユニット
オーディオ機能 シリアルサウンドインタフェース× 4チャネル
ルネサスSPDIFインタフェース
タイマ機能 多機能16ビットタイマ (MTU3) × 8チャネル、32ビットタイマx1チャネル
32ビットOSタイマ×3チャネル
汎用PWMタイマ 32ビット×8チャネル
ウォッチドッグタイマ
リアルタイムクロック
コネクティビティ機能 USB2.0 ホスト/ファンクションモジュールx2チャネル (ホストまたはファンクションを選択可能)
SD/MMCホストインタフェース×2チャネル (SDカードのライセンスを取得していることが必要)
NANDフラッシュメモリインタフェース
イーサネットコントローラx2チャネル (10Mbps/100Mbps転送、IEEE802.3準拠PHYインタフェースMIIおよびRMIIに対応)
SPI マルチI/O バスコントローラ×1チャネル (1チャネルにマルチI/O (Single/Dual/Quad) 対応のシリアルフラッシュメモリ2個まで接続可能/1個のHyperFlashと接続可能、CPUからの直接実行対応)
HyperBusコントローラ
Octaメモリコントローラ
16段FIFO付シリアルコミュニケーションインタフェース (SCIF) ×5 チャネル (調歩同期式とクロック同期式の2方式のシリアル通信が可能)
シリアルコミュニケーションインタフェース ×2 チャネル (スマートカードインタフェース、IrDA規格1.0対応)
ルネサスシリアルペリフェラルインタフェース ×3 チャネル
I2Cバスインタフェース×4 チャネル
コントローラエリアネットワーク (CAN) ×2 チャネル (CAN-FD対応)
システム・アナログ機能 クロック発振器(CPG):PLL内蔵、最大44逓倍、SSCG回路内蔵
ダイレクトメモリアクセスコントローラ ×16 チャネル
割り込みコントローラ (with Arm® PrimeCell® Generic Interrupt Controller [GIC-400]搭載)
A/D変換器 (12ビット分解能) ×8 チャネル
デバッグインタフェース
CoreSightアーキテクチャ採用
JTAG標準端子配置
オプション機能 ダイナミック リコンフィギュアラブル プロセッサ (DRP)
セキュア機能 (Trusted Secure IP) (守秘契約要)
ブートモード ブートモード0:CS0空間に接続されたメモリ (バス幅16ビット) からブート
ブートモード1:SDコントローラ内蔵NANDフラッシュメモリからブート
ブートモード2:MMCコントローラ内蔵NANDフラッシュメモリからブート
ブートモード3:SPIマルチI/Oバス空間に接続されたシリアルNORフラッシュメモリ(3.3V)からブート
ブートモード4:SPIマルチI/Oバス空間に接続されたOctaFlashからブート
ブートモード5:SPIマルチI/Oバス空間に接続されたHyperFlashからブート
ブートモード6:OctaFlash空間に接続されたOctaFlashからブート
ブートモード7:HyperFlash空間に接続されたHyerFlashからブート
低消費電力モード スリープモード
ソフトウェアスタンバイモード
ディープスタンバイモード
モジュールスタンバイモード

ピン数 / メモリサイズのラインアップ:

SRAM

4096KB
ピン数
パッケージ
176
LFBGA
256
LFBGA
272
LFBGA
324
FBGA

ブロック図

Block Diagram

*Arm、Cortex、はArm Limitedの登録商標または商標です。

CAN(Controller Area Network):独Robert Bosch GmbHが提唱している車載用のネットワーク仕様です。

その他、本リリース中の製品名やサービス名は全てそれぞれの所有者に属する商標または登録商標です。

 

関連動画(英語版)


Renesas DRP Dynamic Reconfigurable Processor

The DRP has dynamically reconfigurable processor cores that are programmable in C language and are directly connected to the external I/O ports.


The Future of Embedded Design with RZ/A2M!

Renesas RZ/A2M microprocessors offer an innovative architecture based on the ARM Cortex®-A9 processor and industry-leading 4MB of on-chip memory.

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ソフトウェア/ハードウェア共通情報

タイトル 概要
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ソフトウエア設計支援情報

タイトル 概要
レジスタ定義ファイル 周辺I/Oレジスタの定義を指定した変数から使用できるよう定義するファイルです。
プログラミングにお役立てください。

 

ハードウェア設計支援情報

タイトル 概要
IBIS/BSDL IBISは、高速ボード設計に必要なシミュレーションデータで、実際のボードを作る前のシミュレーションが
可能になり、事前に波形の反射、リンギングなどの問題点の検討をすることができます。 BSDLは、JTAGのIEEE 1149.1準拠のツールの多くでサポートされているデータ入力フォーマットです。 これらのツールでは、自動テストパターン生成(ATPG) および自動テスト装置 (ATE) 機能によりテストが容易になります。
サンプルコードとアプリケーションノートを掲載しています。各フィルタで絞込みを行えます。

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